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分配电路生产加工制造工艺专利技术

1、多通道时钟分配及信号同步和分配电路及其选控方法
    [专利简介]:本发明提供了一种多通道时钟分配及信号同步和分配电路及选控方法,通过控制端选择电路工作在多通道时钟分配模式或信号同步和分配模式;工作在多通道时钟分配模式时,两个D触发器的时钟输入端和第一输入端缓冲器的两个输出端断开;时钟输入通过控制端选择第一输入端或第二输入端输入;工作在信号同步和分配电路模式时,两个D触发器的时钟输入端和第一输入端缓冲器的两个输出端连接;信号通过第二输入端输入。能够直接覆盖单一的时钟分配芯片功能,实现多通道时钟分配。同时,还具有信号同步和分配功能,替换典型的信号同步和分配功能多芯片解决方案。

002、多通道时钟分配及信号同步和分配电路
    [专利简介]:本实用新型提供了一种多通道时钟分配及信号同步和分配电路,包括控制端、第一输入端、第二输入端、第一D触发器、第二D触发器、多路选择器和多通道输出电路;所述多路选择器分别与控制端和多通道输出电路相连;所述第一输入端和第二输入端分别通过各自的缓冲器与多路选择器相连;所述第一D触发器和第二D触发器的两个时钟端对应相连,两个时钟端又分别通过第一开关与第一输入端缓冲器的两个输出端相连;所述第一D触发器的两个输入端分别通过第二开关与第二输入端的两个端口相连;所述第一D触发器的输出端与第二D触发器的输入端相连,第二D触发器的输出端与多路选择器相连。能够实现多通道时钟分配,还具有信号同步和分配功能。

003、功率分配电路
    [专利简介]:变压器(2A)输出正相信号(Vout2Ap)的相位θ1+90°和反相信号(Vout2An)的相位θ1-90°的差动信号。变压器(2B)输出正相信号(Vout2Bp)的相位θ2+90°和反相信号(Vout2Bn)的相位θ2-90°的差动信号。加法电路(3)对每个正相信号和反相信号向量相加来自变压器(2A、2B)的2对差动信号,作为校正了在变压器(2A、2B)中产生的相位误差(θ1-θ2)的信号而合成为1对差动输出信号。

004、数字译码分配电路及成人睡眠监护器
    [专利简介]:本实用新型公开一种数字译码分配电路及成人睡眠监护器,包括相互连接的数字译码电路和数字分配电路,所述数字译码电路和数字分配电路都设有若干二输入端与门电路以及若干三输入端与门电路;所述数字译码电路还设有若干反相器,所述反相器分别与数字译码电路内的二输入端与门电路以及数字译码电路内的三输入端与门电路配合连接;所述数字译码电路和数字分配电路之间还设有二极管以及延时器。本实用新型用于申请人设计的成人睡眠监护器使用,制作成本低,而且结构可靠。

005、信号分配电路、信号分配装置和显示装置
    [专利简介]:本发明的信号分配装置包括:向信号分配电路的开关元件供给输入信号的供给线(5);和经由开关元件将上述输入信号分配至输出端子的分配线(6),供给线(5)和至少一个分配线(6)具有沿被施加切换开关元件的导通断开的选择信号的控制线(13)的延伸方向延伸的延伸部(5a)和延伸部(5b),上述延伸部(5a)和延伸部(5b)形成于与控制线(13)的沿延伸方向的边缘部没有重叠的位置。

006、时钟分配电路和其方法
    [专利简介]:一种时钟分配(clockdistribution)电路,包括一比较单元、一滤波器、一缩放单元、和一震荡器。比较单元是由一相位频率检测器与一电荷泵浦构成。上述比较单元比较一参考讯号和一回馈(feedback)讯号用以产生一误差讯号输入至滤波器。上述滤波器,耦接到上述比较单元,根据上述误差讯号输出一滤波讯号。上述缩放单元,耦接到上述滤波器,利用一缩放因子缩放上述滤波讯号用以形成一控制讯号。上述震荡器,耦接到上述缩放单元,根据上述控制讯号产生上述回馈讯号。上述缩放因子小于1。且上述缩放单元以小于1的上述缩放因子缩小上述滤波讯号内的噪声。

007、同步振荡器、时钟恢复装置、时钟分配电路和多模式注入电路
    [专利简介]:在此公开了同步振荡器、时钟恢复装置、时钟分配电路和多模式注入电路。所述同步振荡器包括:至少一个注入电路,其具有注入信号输入端、内部时钟信号输入端和时钟输出端;以及至少一个延迟电路,其级联到所述注入电路。

008、一种GaAs HBT超高速时钟分配电路
    [专利简介]:本发明公开了一种GaAsHBT超高速时钟分配电路,包括:时钟预驱动器,用于对输入的正弦差分时钟信号CLK_P和CLK_N进行缓冲放大,并输出给第二级时钟驱动器;第二级时钟驱动器,在电路中的具体数目与其所要驱动的负载数目有关,用于将时钟预驱动器的输出信号C1_P和C1_N进行再次缓冲放大,并输出给时钟路径传输线;时钟路径传输线,作为时钟信号传播路径,用于将第二级时钟驱动器输出的时钟信号C2_P、C2_N和C3_P、C3_N传输到负载;时钟路径传输线上的串联电阻及端接阻容网络,用于提高整个超高电路中时钟信号的完整性。利用本发明,提供了完好的时钟信号完整性。

009、分配电路
    [专利简介]:一种分配电路,改善输出端口之间的隔离。包括:输入端口;输出端口(2);输出端口(3);FET(6),位于输入端口和输出端口(2)之间,将输入端口的信号放大而输出到输出端口(2);FET(11),位于输入端口和输出端口(3)之间,将输入端口的信号放大而输出到输出端口(3);以及阻抗电路,连接在输出端口(2)、(3)之间。阻抗电路包括:一端连接到输出端口(2)、并且包括串联的电感器和二极管的串联电路;一端连接到输出端口(3)、并且包括串联的电感器和二极管的串联电路;以及电阻元件,连接在两个串联电路的另一端与接地之间。二极管被连接成在电源的电压提供到FET(6)、(11)的情况下电流向正方向流动。

010、电阻分配电路
    [专利简介]:一种电阻分配电路,包括:电阻元件,在设置于基板上且相互平行布置的第一线段和第二线段中的区域上形成该电阻元件;以及抽头部分,其在第一线段侧的预定位置处连接到电阻元件。沿电阻元件的纵向在与该预定位置相对应的位置上形成切口,在所述切口中不存在电阻元件。在这种结构中,能够降低实际生成的分电压与其设计值之间的偏差,以便可以实现良好校正的灰度显示。

011、时钟分配电路和其方法
    [专利简介]:一种时钟分配(clock distribution)电路,包括一比较单元、一滤波器、一缩放单元、和一震荡器。比较单元是由一相位频率检测器与一电荷泵浦构成。上述比较单元比较一参考讯号和一回馈(feedback)讯号用以产生一误差讯号输入至滤波器。上述滤波器,耦接到上述比较单元,根据上述误差讯号输出一滤波讯号。上述缩放单元,耦接到上述滤波器,利用一缩放因子缩放上述滤波讯号用以形成一控制讯号。上述震荡器,耦接到上述缩放单元,根据上述控制讯号产生上述回馈讯号。上述缩放因子小于1。

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